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全球领先的测试、丈量和监测提供商---泰克公司日前宣布，其将在201 设计自动化大会（6月2-6日，德克萨斯州奥斯汀，819展位）上展出其最新推出的Certus2.0ASIC原型(prototyping)调试解决方案。设计自动化大会(DAC)是以电子系统(EDA)、嵌入式系统及软件(ESS)和知识产权(IP)为主题的重要大会。

首次在设计自动化大会上亮相的Certus2.0软件套件和基于RTL的嵌入式仪器通过帮助实现完全的RTL级可视性使FPGA内部可视性成为原型化平台的特性，从根本上改变了ASIC原型化流程。仿真级可视性使工程师能够使用现有工具在一天内诊断多个缺点，而不需要花一个星期或更多时间。

FPGA合作生态系统范围内一直缺少针对ASIC原型的主动式调试功能 ，泰克公司嵌入式仪器事业部总经理DaveFarrell表示， 设计自动化大会参加者现在将能亲眼目睹Certus2.0如何从根本上改变ASIC原型化流程和显著提高调试效率。

主动式调试策略

Certus2.0允许设计人员自动调试多FPGAASIC原型中的每一个FPGA可能需要的所有信号而很少影响FPGA的LUT。这有助于采取主动式调试和工具化策略，使得无需通过对FPGA进行重新编译来调试每一个新行动，而这在使用传统工具时通常是一项需要8-18个小时的艰苦任务。其他重要功能包括：

根据类型和实例名称（包括触发器[flip-flop]、状态机、接口和枚举类型）进行RTL信号的自动识别和工具化；

片上处理取高度紧缩的快速捕获数据，无需使用特殊外部硬件或消耗FPGAI/O资源；

先进的片上（on-chip）触发功能使嵌入式仪器也能利用逻辑分析仪触发方法；

以时间相关方式捕获来自不同时钟域和多个FPGA的捕获数据提供了完全的目标设计的系统级视图。

Certus2.0可运行于任何现有商业或定制ASIC原型化平台，且无需特殊连接器、电缆或外部硬件。

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